BSV SChnittstelle in Hardware

mProg
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BSV SChnittstelle in Hardware

Beitrag von mProg » 19. Feb 2017 18:41

Auf Folie 141 ist der Interface auf Verilog abgebildet. Für den Port clear ist ein output Port RDY definiert. Kann man das nicht wegoptimieren, da es ja immer TRUE ist?

JHofmann
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Re: BSV SChnittstelle in Hardware

Beitrag von JHofmann » 19. Feb 2017 18:46

Wenn Sie sich sicher sind können Sie

Code: Alles auswählen

(*always_ready*)
verwenden. Das wird dann allerdings auch durch den Compiler sichergestellt.

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